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FPGA et processeurs reconfigurables (ETRS804_ESET)

  • Composante

    UFR Sciences et Montagne

Description

Ce module est une initiation aux SOPC (System On Programmable Chip). Les étudiants apprennent ainsi à utiliser un processeur implémenté dans un FPGA.

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Objectifs

Concevoir et appréhender des systèmes complexes à base de FPGA.

Savoir utiliser des IPs et des processeurs reconfigurables.

Maîtriser la conception de circuits numériques synchrones.

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Heures d'enseignement

  • CMCours Magistral10,5h
  • TDTravaux Dirigés9h
  • TPTravaux Pratiques12h

Pré-requis obligatoires

Notions de VHDL.

Connaissances sur l’architecture d’un FPGA.

Maitrise du fonctionnement d’un processeur.

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Plan du cours

  1. Rappels de VHDL
  2. Méthodologie de conception synchrone
  3. Microprocesseurs (architecture et performances)
  4. Design re-use (IP, exemples de processeurs reconfigurables, bus d’interfaçage et operating system)
  5. V. Processeur NIOS II (architecture et jeu d’instruction)
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Compétences visées

Concevoir et réaliser une application sur SOPC (System On Programmable Chip) :

- Implémenter un système à base de NIOS II dans un FPGA

- Ecrire des programmes en assembleur et en C pouvant tourner sur NIOS II

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